DSP原理与应用TIMER.ppt

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定时器模块结构框图定时器模块结构框图定时器模块具有如下的特性：定时器模块具有如下的特性：u 两个产生不同时间基的独立计数器模块，每两个产生不同时间基的独立计数器模块，每个模块包括：一个个模块包括：一个32位的预定标计数器；一个位的预定标计数器；一个32位的自由运行计数器；两个用于捕捉特定事位的自由运行计数器；两个用于捕捉特定事件预定标和自由运行计数器的寄存器件预定标和自由运行计数器的寄存器u 自由运行计数器自由运行计数器0和和1可以通过内部预定标计可以通过内部预定标计数器来增值数器来增值u 四个用于产生中断的可配置比较寄存器，可四个用于产生中断的可配置比较寄存器，可以跟计数器以跟计数器0也可以跟计数器也可以跟计数器1一起工作。比较一起工作。比较0和和3还可以产生还可以产生DMA请求信号请求信号u 在比较匹配时自动更新所有的比较寄存器，在比较匹配时自动更新所有的比较寄存器，来产生周期性的中断。来产生周期性的中断。u 快速使能快速使能/禁止中断禁止中断u 数字看门狗数字看门狗u 由由SYSCLK2分频得到分频得到RTI输入时钟输入时钟(RTICLK)Timer Control Register (CTL)Timer Control Register (CTL)Timer Period Register (PRD)Timer Count Register (CNT)示例：示例：0701